EP1C3T144C8N 사이클론 FPGA 2,910 LEs 144-Pin TQFP 3.3V 운영 칩 PLL 내장 제어 및 프로토타입을 위한 저비용 및 유연한 I/O

EP1C3T144C8N 사이클론 FPGA, 2,910 LEs, 144핀 TQFP, 3.3V 작동, 온칩 PLL, 저가형 및 임베디드 제어 및 프로토타입 제작을 위한 유연한 I/O

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특징

■ 2,910 ~ 20,060 LEs, 표 1andndash;1 참조

■ 최대 294,912 RAM 비트(36,864 바이트)

■ 저가형 직렬 구성 장치를 통한 구성 지원

■ LVTTL, LVCMOS, SSTL-2 및 SSTL-3 I/O 표준 지원

■ 66MHz 및 33MHz, 64비트 및 32비트 PCI 표준 지원

■ 고속(640Mbps) LVDS I/O 지원

■ 저속(311Mbps) LVDS I/O 지원

■ 311Mbps RSDS I/O 지원

■ 장치당 최대 2개의 PLL은 클럭 곱셈 및 위상 이동 제공

■ 랩(LAB) 행당 6개의 클럭 리소스를 사용할 수 있는 최대 8개의 글로벌 클럭 라인

■ DDR SDRAM(133MHz), FCRAM 및 단일 데이터 속도(SDR) SDRAM을 포함한 외부 메모리 지원

■ Alteraandreg; MegaCoreandreg; 기능 및 Altera Megafunctions Partners Program (AMPPSM) 메가기능을 포함한 여러 지적 재산(IP) 코어 지원

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설명

Cycloneandreg; 장치는 사용자 정의 로직을 구현하기 위해 2차원 행 및 열 기반 아키텍처를 포함합니다. 다양한 속도의 열 및 행 상호 연결은 LAB와 임베디드 메모리 블록 간의 신호 상호 연결을 제공합니다.

로직 어레이는 각 LAB에 10개의 LE가 있는 LAB로 구성됩니다. LE는 사용자 로직 기능을 효율적으로 구현하는 작은 로직 단위입니다. LAB는 장치 전체에 걸쳐 행과 열로 그룹화됩니다. Cyclone 장치는 2,910 ~ 20,060 LEs의 범위를 갖습니다.

M4K RAM 블록은 4K 비트의 메모리 및 패리티(4,608 비트)를 갖춘 진정한 듀얼 포트 메모리 블록입니다. 이러한 블록은 최대 250MHz에서 최대 36비트 너비의 전용 듀얼 포트, 단순 듀얼 포트 또는 단일 포트 메모리를 제공합니다. 이러한 블록은 특정 LAB 사이에 장치 전체에 걸쳐 열로 그룹화됩니다. Cyclone 장치는 60 ~ 288Kbits의 임베디드 RAM을 제공합니다.

각 Cyclone 장치 I/O 핀은 장치 주변의 LAB 행과 열 끝에 위치한 I/O 요소(IOE)에 의해 공급됩니다. I/O 핀은 66MHz 및 33MHz, 64비트 및 32비트 PCI 표준 및 최대 640Mbps의 LVDS I/O 표준과 같은 다양한 단일 종단 및 차동 I/O 표준을 지원합니다. 각 IOE에는 양방향 I/O 버퍼와 입력, 출력 및 출력 활성화 신호를 등록하기 위한 3개의 레지스터가 포함되어 있습니다. 듀얼 목적 DQS, DQ 및 DM 핀과 지연 체인(DDR 신호 위상 정렬에 사용)은 최대 133MHz(266Mbps)에서 DDR SDRAM 및 FCRAM 장치와 같은 외부 메모리 장치와의 인터페이스 지원을 제공합니다.

Cyclone 장치는 글로벌 클럭 네트워크와 최대 2개의 PLL을 제공합니다. 글로벌 클럭 네트워크는 전체 장치를 구동하는 8개의 글로벌 클럭 라인으로 구성됩니다. 글로벌 클럭 네트워크는 IOE, LE 및 메모리 블록과 같은 장치 내의 모든 리소스에 클럭을 제공할 수 있습니다. 글로벌 클럭 라인은 제어 신호에도 사용할 수 있습니다. Cyclone PLL은 고속 차동 I/O 지원을 위한 외부 출력뿐만 아니라 클럭 곱셈 및 위상 이동을 통해 범용 클럭킹을 제공합니다.

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정보

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도면

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